第 5 阶段 · Allegro 17.4 软件入门 · 必须实操
5-04 Find / Select / Query:准确选择和查看 PCB 对象
能先限定候选对象,再用17.4元素查询核对身份、网络和位置。
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软件版本:Cadence Allegro PCB Editor 17.4;已验证与待验证操作在正文分别标明。
上一课知道坐标是位置。本课再分清:点击的位置,不等于最终选择的对象身份。先限定候选类别,再通过属性核对。
快速理解 · 为什么同一处会选错
一处位置可能有铜线、过孔和文字。Select(选择) 除了位置,还受当前命令、显示范围和候选类别影响。Find(查找与选择页签) 中的 Design Object Find Filter(设计对象选择过滤器) 就是告诉软件“这次允许找哪类对象”。
绿色铜线、圆形过孔和位号文字在此重叠。这个练习仅说明过滤思想,不仿真软件的完整拾取优先级。
先限定对象类别,再点选;最后还要用属性核对身份。
把常用对象与真实选项对应
日常说 Component(元器件),本机相关候选项可见 Symbols(本界面中的器件封装实例选项)。不要把它和原理图中的符号混为一谈;当前命令不同,某些选项也会灰显。
Clines / Cline segs(电气走线 / 走线段) 是电气连接对象。选择整条和选择一段,操作范围可能不同;本课只查询,不编辑它们。
Via / Vias(过孔 / 过孔选项)、Pin / Pins(引脚 / 板上引脚选项) 分别帮助你限定过孔或器件连接端。Text / Lines(文字 / 普通几何线选项) 则用于文字及普通绘图线,不能看到一条线就认定它属于某个电气网络。
Query(查询) 最终是为了确认对象身份,而不只是让画面变亮。下面使用本机已验证的元素查询入口。
真实17.4操作 · 只查询一个过孔
先执行 Display → Element / Show Element(显示 → 元素 / 元素信息窗口),再切到Find。按 All Off(全部取消) 后,只勾 Vias(过孔)。下图先看过滤器顶部和唯一勾选的过孔项。
在已显示的过孔处点击,查询窗口就能显示该对象的实际属性。找不到时先放大并核对显示与过滤条件;不要改成移动或删除命令去“试试看”。
属性是证据,不只是一串数字
本次选中过孔后,报告中有 origin-xy / Part of net(对象原点坐标 / 所属网络)。对象位置与鼠标最后点击位置未必完全相同,要分清你抄的是哪一个。
不同对象有不同字段。过孔报告不必有走线宽度,不能要求每个对象都出现完全相同的属性列表。
为什么?深入理解 · 过滤、命令、显示要一起看
过滤器不是“强制选中”
只允许过孔,不代表随便点哪里都能选到过孔。位置附近还必须有符合当前命令要求的候选对象;被隐藏的内容也可能无法按你预期拾取。
选项会随任务变化
菜单式命令和先选择对象再操作的工作方式,可能呈现不同候选项。本课先打开查询命令再设过滤,减少新手在未知命令状态下照搬勾选项。
结果要二次确认
选中后读对象类型、网络和位置,再决定后续动作。高亮只是提示,不足以证明选中的正是你要的对象。
主操作练习 · 在自己的练习副本中做一次
- 在网页练习里,分别允许过孔和文字,点选同一位置,解释两次结果为何不同。
- 打开自己的练习板副本,执行已验证的元素查询入口,切到Find,先全部取消再只勾Vias。
- 放大一个可见过孔并查询,记录对象类型、所属网络和位置。对照当前单位,不从鼠标点击记录代替对象坐标。
- 关闭查询结果窗口,检查命令反馈区。不要把一次按键当作所有命令都已结束;本课不接着进行任何编辑。
完成证据:你的记录能说明“我查看的是哪一类对象,属于哪个网络,位于哪里”。
以后做 Layout 有什么用
Layout(布局布线) 时,过滤可以减少误选,属性查询可以防止在错误对象上继续操作。将来移动器件、修改铜线之前,都要先确认对象身份。
筛选条件不会删除其他对象,也不会自动修复网络。不同命令下的右键结束操作仍需按真实提示核对,本课没有编造统一快捷键。
提示
文字和器件实例是两个不同对象。
相同位置可能有多个对象。先限定类别,再通过报告确认;不要把文字选中当作整个器件选中。
本课记住
- 位置、当前命令和选择过滤共同影响选择结果。
- 普通线、文字、器件实例和电气走线不能混为一类。
- 查询属性是确认身份,显示高亮只是提示。
下一课学习显示控制:为什么软件中很多“层”并不是物理铜层。
来源与17.4验证范围
实机过滤示例和属性报告已取得;未实测的其他查询方式不写成操作路径。
主要依据:本机17.4-2019 S007实际操作及配套官方文档的编辑器入门指南、用户指南。课程截图是实际采集,黄色框与中文说明为教学标注;原创练习图另行注明,不冒充软件界面。
实机使用安装示例板的副本,仅用于识别软件对象,不作为电路设计范本。具体路径与截图证据记录在项目的17.4验证清单中。